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maxwell_3d: Add depth buffer enable, width, and height registers.
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5287991a36
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@ -487,7 +487,12 @@ public:
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};
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};
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} rt_control;
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} rt_control;
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INSERT_PADDING_WORDS(0x2B);
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INSERT_PADDING_WORDS(0x2);
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u32 zeta_width;
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u32 zeta_height;
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INSERT_PADDING_WORDS(0x27);
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u32 depth_test_enable;
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u32 depth_test_enable;
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@ -540,7 +545,11 @@ public:
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u32 vb_element_base;
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u32 vb_element_base;
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INSERT_PADDING_WORDS(0x49);
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INSERT_PADDING_WORDS(0x40);
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u32 zeta_enable;
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INSERT_PADDING_WORDS(0x8);
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struct {
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struct {
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u32 tsc_address_high;
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u32 tsc_address_high;
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@ -865,6 +874,8 @@ ASSERT_REG_POSITION(clear_depth, 0x364);
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||||||
ASSERT_REG_POSITION(zeta, 0x3F8);
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ASSERT_REG_POSITION(zeta, 0x3F8);
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||||||
ASSERT_REG_POSITION(vertex_attrib_format[0], 0x458);
|
ASSERT_REG_POSITION(vertex_attrib_format[0], 0x458);
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||||||
ASSERT_REG_POSITION(rt_control, 0x487);
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ASSERT_REG_POSITION(rt_control, 0x487);
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||||||
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ASSERT_REG_POSITION(zeta_width, 0x48a);
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||||||
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ASSERT_REG_POSITION(zeta_height, 0x48b);
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||||||
ASSERT_REG_POSITION(depth_test_enable, 0x4B3);
|
ASSERT_REG_POSITION(depth_test_enable, 0x4B3);
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||||||
ASSERT_REG_POSITION(independent_blend_enable, 0x4B9);
|
ASSERT_REG_POSITION(independent_blend_enable, 0x4B9);
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||||||
ASSERT_REG_POSITION(depth_write_enabled, 0x4BA);
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ASSERT_REG_POSITION(depth_write_enabled, 0x4BA);
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||||||
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@ -874,6 +885,7 @@ ASSERT_REG_POSITION(blend, 0x4CF);
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||||||
ASSERT_REG_POSITION(stencil, 0x4E0);
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ASSERT_REG_POSITION(stencil, 0x4E0);
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||||||
ASSERT_REG_POSITION(screen_y_control, 0x4EB);
|
ASSERT_REG_POSITION(screen_y_control, 0x4EB);
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||||||
ASSERT_REG_POSITION(vb_element_base, 0x50D);
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ASSERT_REG_POSITION(vb_element_base, 0x50D);
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||||||
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ASSERT_REG_POSITION(zeta_enable, 0x54E);
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||||||
ASSERT_REG_POSITION(tsc, 0x557);
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ASSERT_REG_POSITION(tsc, 0x557);
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||||||
ASSERT_REG_POSITION(tic, 0x55D);
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ASSERT_REG_POSITION(tic, 0x55D);
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||||||
ASSERT_REG_POSITION(stencil_two_side, 0x565);
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ASSERT_REG_POSITION(stencil_two_side, 0x565);
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